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解析EDA技术的基本特征及应用

作者:admin    来源:未知    发布时间:2020-10-16 23:50    

  计划、体例计划依然芯片计划,其计划的杂乱水准都正在一向地扩展,并且电子产物更新换代的程序也越来越疾。此时,仅仅依附守旧的手工计划方式仍然不再满意请求,而电子计划自愿化(

  EDA时间是一门涉及推算机图形学、微电子工艺等学科的归纳性时间,跟着推算机、集成电道、电子体例计划的生长,体验了一个由浅到深的流程。

  从20世纪60年代中期最先的CAD阶段,人们就应用各样推算机辅助计划器材来代替了手工操作,因为受到推算机事业平台的限制,其助助的计划事业有限,功能斗劲差。20世纪80年代的CAE阶段,人们采用同一的数据管制时间将各个器材集成为一个别例,供给准绳元件库,然则,大个别从道理图起程的CAE器材依旧不行适宜杂乱电子体例的请求,并且的确的元件图形也限制着优化计划。20世纪90年代此后的ESDA阶段,电子工艺程度仍然抵达了深亚微米级,芯片的事业频率抵达GHz级,正在这一阶段,产生了以硬件描摹说话、体例级仿真和归纳时间为根本特性的第三代EDA时间,它使计划师们脱离了豪爽的的确计划事业,而把元气心灵纠合于缔造性的计划与观念构想上,从而极大地进步了体例计划的效力,缩短了产物的研制周期。

  摩登EDA时间是采用高级说话描摹,具有体例级仿真和归纳本事。它苛重采用并行工程和“自顶向下”的计划方式,使开拓者从一最先就要琢磨到产物天生周期的诸众方面,征求质地、本钱、开拓时辰及用户的需求等,然后从体例计划人手,正在顶层实行性能方框图的划分和构造计划,正在方框图一级实行仿真、纠错、并用VHDL,Verilog一HDL,ABEL等硬件描摹说话对高方针的体例举动实行描摹,正在体例一级实行验证,然后再用逻辑归纳优化器材天生的确的门级逻辑电道的网外,其对应的物理实行级能够是印刷电道板或专用集成电道。近几年来,硬件描摹说话等计划数据方式的逐渐准绳化,正在分歧计划品格和行使的请求方面,导致各具特性的EDA器材被集成正在统一事业站上,从而使EDA框架日趋准绳化。

  目前中邦正正在从“中邦创设”走向“中邦缔造”,党的十六大提出“优先生长消息家产”,跟着电子时间的飞速生长,稀奇是集成电道的产生,使电子电道逐渐离别分立元件时期,向小型化、集成化目标生长,要开拓具有我邦自助学问产权的硬件电道,就务必实行ASIC,SOC的计划,就务必应用EDA器材。但我邦EDA时间的推敲和行使起步较晚、程度很低,正在EDA的总体行使本事方面与寰宇发展邦度比拟,浮现为专业人才紧缺、缺乏成熟化的整合性集成计划处境,专业职员培训上的掉队,导致正在时间改进、消息化程度等要害方面的邦际逐鹿力与跨邦公司另有较大差异。

  正在计划方式上,计划者采用一种高方针的“自顶向下”的全新计划方式,与过去选取准绳集成电道“自底向上”地构制出一个新的体例比拟,因为计划的苛重仿真和调试流程是正在高方针上竣事的,这不光有利于早期发明构造计划上的毛病,避免计划事业的华侈,并且也节减了逻辑性能仿真的事业量,避免计划效力低、本钱高、容易堕落,进步了计划的一次凯旋率。近几年来跟着消息时期的到来,“消息交互”和“消息处罚”两类的行使使数字化产物需求日益茂盛,通讯、众媒体等市集需求增大,SOC芯片正在中高级方面将代替守旧意思上的CPU,满意人们以GUI屏幕为核心的众媒体界面与消息终端交互的需求。

  各样新器件、新时间、新方式迭出无量,人们开拓的电子体例也越来越雄伟、越来越杂乱、请求也越来越高,要剖释和计划杂乱的电子体例,人工的方式已不实用,为适宜这种近况,日趋完满的EDA时间正正在逐渐代替守旧的电子计划方式。对更低本钱、更低功耗的无终点寻求和越来越短的产物上市压力,迫使IC供应商一向开拓体例芯片,而这些体例芯片的杂乱性计划特别依赖于EDA时间,EDA是目前最新最周到的电子计划时间及器材,它的产生为电子计划事业家供给了一种全新的计划方式。于是,职掌EDA时间,是走向市集、走向社会、走向邦际的根本技巧。

  下面以Alter公司的可编程器件开拓器材MAX+plusII为平台〔1-2),采用方针化计划方式,计划一个十字道口的交通讯号灯的驾驭电道。

  本计划采用方针描摹办法,也采用道理图输人和文本输人搀杂办法兴办描摹文献。图I是交通管制器顶层图形输人文献,它用道理图事势证明体例的构成,即体例由驾驭器和3个守时计数器构成;3个守时计数器的模辨别为26,5和30a正在顶层图形文献中的各模块,其性能用第=方针VHDL源文献描摹。

  编辑器将顶层图形文献和第=方针性能块VHDL输人文献相团结并编译,确定准确无误后,即可形成交通管制器的对象文献。

  对源法式实行编译,查抄语法,查抄逻辑性能是否准确,体验证此例的体例逻辑性能准确,其交通管制器的仿真波形。能够看出,起首是甲道禁止(r1为高电平),乙道通行(薛为高电平);源委30s后,转换成甲道禁止(rl为高电平),乙道泊车(舜为高电平);源委5s后,转换成甲道通行(g1为高电平),乙道禁止(r2为高电平);源委26s后,转换成甲道泊车(y1为高电平),乙道禁止(r2为高电平);再源委5s后,再次转换成甲道禁止(rl为高电平),乙道通行(夕为高电平)状况,竣事一个事业轮回。

  本文改进点:电子体例的计划输人能够用道理图、波形、VHDL说话等办法输人,下载修设前的所有流程简直不涉及到所有硬件,而硬件计划的批改也犹如批改软件法式相似疾速容易,即通过软件办法的计划与测试,抵达对特定性能的硬件电道的计划实行。它能辅助时间职员实行疾速、准确的产物计划,真正做到“计划即准确”。

  与此同时,EDA处境也将一向进取,以适宜体例开拓的需求,极少新兴的EDA公司还供给出了要点生长C++++说话、准绳单位库和网上计划供职等新的生长战略,而且开拓基于C++说话的硬件描摹器材,采用C++为计划说话,不单运转速率比HDL疾2-3个数目级,并且可为IP供应商供给学问产权保卫,这些又为EDA时间的生长注人了新的生机。

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